稳定性自主筛选PUF电路建模及VLSI设计关键技术研究

基本信息
批准号:61904125
项目类别:青年科学基金项目
资助金额:26.00
负责人:李刚
学科分类:
依托单位:温州大学
批准年份:2019
结题年份:2022
起止时间:2020-01-01 - 2022-12-31
项目状态: 已结题
项目参与者:
关键词:
物理不可克隆函数设计稳定性VLSI设计PUF编译器
结项摘要

By extracting process deviations in the process of chip manufacturing, Physical Unclonable Function (PUF) circuit can easily generate security keys with characteristic of uniqueness, randomness and tamper-proof. PUF are being widely used in the field of information security. However, there are some shortcomings in the design and application of PUF circuit, such as long cycle of full customized layout design, high cost of stability screening. In view of this, this study aims to reveal the inherent relationship between the stability of PUF circuit output and process deviation by studying the mechanism of integrated circuit process deviation, explore the new mechanism of PUF circuit stability screening, propose stability autonomous screening scheme for PUF circuit, and realize automatic compilation of PUF circuit. The object of the research is stability autonomous screening of PUF circuit, and the main content includes the circuit's model construction, structure design, automatic compilation, and performance evaluation and optimization. The research results are expected to provide scientific theory and methodology for VLSI design and stability screening of high performance PUF circuit and to promote a better application of PUF circuit in the field of information security.

物理不可克隆函数(Physical Unclonable Function, PUF)电路,通过正向提取芯片制造过程中无法避免引入的工艺偏差,易产生具有随机性、唯一性以及防篡改特性的安全密钥,可广泛应用于信息安全领域。然而PUF电路在具体设计与应用时存在着全定制版图设计周期长、稳定性筛选成本高等方面的不足。鉴此,本项研究旨在通过对集成电路工艺偏差机理的研究,揭示PUF电路输出密钥的稳定性与工艺偏差的内在关系,探索PUF电路稳定性筛选新机制,提出PUF电路稳定性自主筛选方案,实现PUF电路自动编译。主要研究内容包括:稳定性自主筛选PUF电路模型构建;稳定性自主筛选PUF电路结构设计;稳定性自主筛选PUF电路自动编译;稳定性自主筛选PUF电路性能评测与优化等。研究成果将为高性能PUF电路的VLSI设计及稳定性筛选提供科学的理论依据和方法指导,促进PUF电路在信息安全领域的更好应用。

项目摘要

物理不可克隆函数(Physical Unclonable Function, PUF)电路,通过正向提取芯片制造过程中无法避免引入的工艺偏差,易产生具有随机性、唯一性以及防篡改特性的安全密钥,可广泛应用于信息安全领域,如集成电路硬件安全、物联网安全等。然而PUF电路在具体设计与应用时存在着全定制版图设计周期长、稳定性筛选成本高等方面的不足。.通过对集成电路工艺偏差机理的研究,项目揭示了PUF电路输出密钥的稳定性与工艺偏差的内在关系,探索了PUF电路稳定性筛选新机制,提出了多种PUF电路稳定性自主筛选方案,实现了PUF电路自动编译。此外,面向集成电路硬件安全和物联网安全等国家战略需求,本项目发展了多款高性能PUF芯片,并初步探索了强PUF机器学习攻击及防御方法。主要研究内容包括:稳定性自主筛选PUF电路模型构建,稳定性自主筛选PUF电路结构设计,稳定性自主筛选PUF电路性能评测与优化,高性能PUF电路设计与实现,PUF机器学习攻击及防御技术等。.项目研究任务已顺利完成,所发展或设计的相关模型、理论、算法、电路以及优化方案均经过相应实验验证,性能指标满足预期指标要求或高于同时期已报道同类成果。基于研究成果已发表学术论文12篇,被SCI收录6篇,EI收录4篇。其中国内核心期刊论文2篇,国际会议论文2篇。申请国家发明专利11项,已获授权3项。本项研究培养硕士研究生6人,辅助培养博士生2人,研究成果适应当前社会生活发展的需要,所涉及相关关键技术具有重要理论价值和广阔的应用前景。其进一步转换推广对我国信息安全芯片设计、物联网安全以及国家经济健康发展、社会稳定都具有积极作用。

项目成果
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数据更新时间:2023-05-31

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项目类别:面上项目
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防御DPA攻击的功耗独立模型及VLSI设计关键技术研究

批准号:61274132
批准年份:2012
负责人:汪鹏君
学科分类:F0402
资助金额:89.00
项目类别:面上项目